【开发博客（三）】verilog实现参数化的超前进位加法器和“类UVM”框架搭建

超前进位加法器的原理可以看【HDL系列】超前进位加法器原理与设计其目的是为了在两个加数的位宽都较大时，传统的行波加法器需要大量的时间，导致在单个周期内难以满足时序要求，从而设计出的大幅缩减计算时间的加

【开发博客（二）】verilog实现找到最低位1（Least Significant One）

输入：一个固定位宽的二进制序列，例如0100_0100输出：一个同输入位宽的独热码，标记处最低位1（Least Significant One），例如0011_1100的输入，希望输出0000_010

【开发博客（三）】verilog实现除法器

除法器与乘法、加减法不同，在FPGA与ASIC设计中，乘法与加减法操作都可以直接使用符号*、+、-来实现。在FPGA中，乘法符号会使用一个DSP资源来完成高速的乘法计算，而+、-法则是通过一个LUT；

【开发博客（一）】使用VSCode仿真Verilog和SystemVerilog代码环境搭建

环境搭建的流程大部分按照Digital Lab 2025中的来，但是有所变化的是vscode的verilog插件名称已经改变为Verilog-HDL/SystemVerilog，可能后面还会变但是记得

【生命不息，学习不止】《复旦张双利：从黑格尔到马克思》笔记（1）

原课程隔壁有，搜标题上的课程名，从黑格尔到马克思，就是了。该笔记对应原课程一讲部分，笔记包含个人解读和展开理解，不完全属于原课程内容，黑体部分是课程讲义原文。第一部分：黑格尔法哲学对古典政治经济学的相

大家的日语 第1课　はじめまして

【本课内容】 単語： 私(わたし)：我 わたしたち(わたしたち)：我们 あなた(あなた)：你，妳 あの人(あのひと)：他，她，那个人 皆さん(みなさん)：各位，大家 ……さん(……さん)：……先生，…

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关于教资的一些个人感想

前因大概一年多年吧，悠闲的窝在沙发里的我接到了我妈的电话。她说，疫情这么严重，你年纪也大了，要不考个教师资格证，回家吧。我想了想现实的状态，纠结了一阵子之后，最后决定考教资了。一个天天躺着没啥前途的肥

不会画画的学生不是好学霸！浙大学长学姐的“神级笔记”

浙江大学推出了“最美学习笔记大赛” 各种专业的学霸笔记图“现身”网络 让人惊叹的不只是笔记的内容，更是学霸们的画画功底

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高中教资学科知识与教学能力 英语 语言学2

Morphology形态学Morpheme 语素 the smallest linguistic unit for semantic meaning 分类 inflectional morpholog